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1 0007532336図書一般549.7/ｴﾀ07/書庫貸出可  ○

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書誌情報サマリ

タイトル

Verilog‐HDLによるテストベンチ

人名 枝 均／著
人名ヨミ エダ ヒトシ
出版者・発行者 テクノプレス
出版年月 2006.4

書誌詳細

この資料の書誌詳細情報です。

書誌種別 図書
タイトル Verilog‐HDLによるテストベンチ
サブタイトル アサーション検証の効率化のために
タイトルヨミ ヴェリログ エイチディーエル ニ ヨル テスト ベンチ
サブタイトルヨミ アサーション ケンショウ ノ コウリツカ ノ タメ ニ
人名 枝 均／著
人名ヨミ エダ ヒトシ
出版者・発行者 テクノプレス
出版者・発行者等ヨミ テクノ プレス
出版地・発行地 西東京
出版・発行年月 2006.4
ページ数または枚数・巻数 6,203p
大きさ 21cm
価格 ￥３０００
ISBN 4-924998-66-4
分類記号 549.7
件名 集積回路
内容紹介 RTLレベルまたは論理合成後のゲート・レベルでの論理検証を実行するために、ダイナミック・シミュレータでの検証では必ず使用するテストベンチについてまとめる。taskの使用に重点を置き、サンプルの記述を多く紹介。
言語区分 jpn
タイトルコード 1009810854549



目次


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